Análisis de Circuitos Fractales y Modelado a través de Sistema de Funciones Iteradas para VHDL Caso de estudio: Codificador Reed Solomon
Analysis of Fractal Circuits and Modeling through Iterated Functions System for VHDL
Resumen
La presente investigación corresponde al modelado de circuitos para hardware reconfigurable, basado en la teoría fractal, que aplica conceptos de funciones iteradas para la generación del código de descriptción en VHDL, lo que es un tratamiento novedoso como método de configuración de hardware. El método empleado consisten en el análisis de la estructura fractal de los circuitos: generadores de código Reed Solomon, y los multiplicadores de campos finitos GF, estudiando la arquitectura generalizada del componente LFSR (registros desplazamientos con realimentación lineal), presente en estos. Para futuras aplicaciones, se pretende incluir este desarrollo en control adaptativo y control avanzado aplicando funciones iteradas, con el manejo fractal de los circuitos de implementación. Se obtuvo un conjunto de ecuación con funciones iteradas que reproducen su comportamiento, basados en la estructura fractal del circuito, del modelo se estimó el consumo de recursos hardware, a nivel de operadores lógicos, con lo que el método propuesto muestra eficiencia para su aplicación en sistemas lógicos avanzados. El aporte principal es el manejo matemático de una aplicación experimental, donde se pueden extrapolar los avances e incorporar estos conceptos para nuevos enfoques de diseño. Lo que permite concluir, que el desarrollo optimiza el diseño de circuitos en VHDL, a partir del modelo de funciones iteradas obtenido, simplificando la descripción de hardware parta circuitos paralelos, de alta eficiencia aplicando modelado SFI, siendo una base para la generación de conocimientos en esta rama de la Ingeniería.
Palabras Clave: Estructura Fractal, SFI, LFSR, VHDL, generador de códigos RS, Hardware Reconfigurable.
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